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13个问题
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时钟门电路架构

对于https://www.design-reuse.com/articles/34973/low-power-high-density-clock-gate.html,任何人都可以解释如何下面新近提出的时钟门电路架构的作品?怎么做的 ...
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为什么设置检查和门使用上升边,而或门使用下降边,反之亦然,在时钟门保持检查?

我有set_clock_gating_check SDC命令两个问题。为什么设置检查,AND,NAND门使用上升沿,而OR,NOR门使用下降沿?为什么保持检查,AND,NAND门使用...
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为什么我们在异步FIFO中使用灰色编码信号的2级触发器来避免竞争条件问题?(复制)

在FIFO的设计,比较RPTR和WPTR,我们正在将一种信号转换成另一种时钟域。这是从慢时钟域来更快一项所述的RPTR可以与同步同步...
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如何实现时钟门控风格的RTL合成?

我正在研究如何在RTL中实现时钟门控。所以我在下面的https://www.design-reuse.com/articles/23701/power-analysis-clock-gating-rtl.html…
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时钟门控细胞的故障

究竟怎样发生故障的上升沿和下降沿ICG?为什么上升沿ICG的顶配版本,有在锁存器输出的MSB没有X?注:TE信号是同步的CLK,...
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灿的Quartus帮助用户找出省电若用时钟控制模块,以禁止时钟?

时钟控制块可以用于禁用时钟的设计从而实现时钟门控的一个部分。灿的Quartus帮助用户找出多少节省这样的措施将有助于实现...
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关于基于自动门控触发器的前瞻时钟门控的问题

对于先行时钟门控基于自体门控触发器,为什么?
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关于JK触发器何时被触发的困惑

我最近开始学习锁存和触发器,我的理解是边缘触发设备,比如触发器,忽略它们的输入,直到时钟信号从低到高或…
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在数字世界中,产生脉冲波(高或低)的基本电子元件是什么?

非常常见的我们听到ON/OFF, HIGH/LOW, 1/0,或类似的数字系统。它被称为二进制。我想知道产生这样的二进制系统的最基本的组成部分是什么?我…
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时钟门控降量区域

我在超大规模集成电路课程的幻灯片中读到,时钟门控也可以导致芯片面积减小。在我的理解,时钟门控减少芯片尺寸,因为这种技术需要一个…
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时钟不振荡的正确术语?

对一个时钟输入来说正确的术语是什么它本身不是振动的?在尝试只允许输入A在选定的时间对电路有任何影响时,可以用…
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在fpga中组件实例化之前分配clk给信号是一个好做法吗?

我工作与VHDL为Xilinx fpga,我试图创建一些层次组件。当在另一个组件a中实例化一个组件B时,clk被期望传递给…
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BUFGCE会被优化成FDCE吗?

对于时钟门控的简单逻辑实现,我使用了BUFGCE。在浏览原理图时,我注意到逻辑是使用fdce实现的。但不使用FDCE的CE。我的问题是为什么BUFGCE…